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  • Bonus TCSE 분석

    2021.03.04 by oilbeen

  • Qiskit Hackathon Korea Project 논문 정리

    2021.02.17 by oilbeen

  • RISC-V 컴퓨터구조 - 4. The Processor - 4.8. Control Hazards

    2020.12.03 by oilbeen

  • RISC-V 컴퓨터구조 - 4. The Processor - 4.7. Data Hazards: Forwarding versus Stalling

    2020.12.02 by oilbeen

  • RISC-V 컴퓨터구조 - 4. The Processor - 4.6. Pipelined Datapath and Control

    2020.12.02 by oilbeen

  • RISC-V 컴퓨터구조 - 4. The Processor - 4.5. An Overview of Pipelining

    2020.12.01 by oilbeen

  • 경복궁 야간개장 (드디어 나도!!) - 2020/11/30(월)

    2020.12.01 by oilbeen

  • RISC-V 컴퓨터구조 - 4. The Processor - 4.4. A simple Implementation Scheme

    2020.11.30 by oilbeen

Bonus TCSE 분석

106. How can a brand be durable that would seem to have sustained irreparable damage? A first clue lies, (paradoxically, ironically) enough for an institution that likes to project itself as ancient, in a notion that is quintessentially(참으로, 철저히) modern: celebrity. 돌이킬 수 없는 손상을 입은 것처럼 보이는 브랜드는 어떻게 버틸 수 있을까? 첫 번째 단서는 (역설적으로) 고대인 것처럼 자신을 투영하고 싶어하는 기관이 본질적으로 현대적인 개념인 유명인사라는 개념에 있다는 것이다.

GRE 2021. 3. 4. 22:22

Qiskit Hackathon Korea Project 논문 정리

Efficient evaluation of quantum observables using entangled measurements npj Qunatum Information, Ikko Hamamura and Takashi Imamichi (www.nature.com/articles/s41534-020-0284-2) Abstract: 클라우드 양자컴퓨팅의 출현은 양자 알고리즘이 빠르게 발전하는데 기여하였다. 특히 이 중에서도 noisy intermediate-scale quantum(NISQ) 컴퓨터에서도 실행 가능한 variational quantum-classical hybrid algorithm들을 연구하는 것이 중요하다. Observable들을 evaluate하는 과정은 variational qua..

화학 2021. 2. 17. 15:37

RISC-V 컴퓨터구조 - 4. The Processor - 4.8. Control Hazards

만약 beq x1, x2, L1 다음에 add x1, x2, x3라는 instruction이 온다고 하자. 만약 x1과 x2가 같지 않다면 이 add instruction이 시행되겠지만, 같다면 L1위치에 있는 instruction으로 넘어갈 것이다. 따라서 다음 instruction인 add를 할지 말지 결정해야 하는데, 이는 memory stage가 되어서야 알 수 있으므로, 3 clock cycle의 stall이 필요한데, 모든 상황에서 이렇게 하면 너무 비효율적이다. 따라서 가정을 한다. Assume Branch Not Taken Branch가 무조건 Not Taken 된다고 가정한다음 다음 instruction을 그냥 진행시킨다. 그러다가 만약 branch가 take되어 버리면, 지금까지 한 것..

Computer Engineering/Computer Architecture 2020. 12. 3. 03:06

RISC-V 컴퓨터구조 - 4. The Processor - 4.7. Data Hazards: Forwarding versus Stalling

만약 다음과 같은 명령어들이 있다고 하자. sub x2, x1, x3 and x12, x2, x5 or x13, x6, x2 add x14, x2, x2 sd x15, 100(x2) 이런 다섯 개의 code가 sequential 하게 있다고 하면, 첫번째 명령에서의 sub에서 나오는 결과인 x2의 값이 뒤의 and와 or에도 이용되므로, 만약 그냥 앞에서 한 방법대로 진행하게 되면, 다음과 같은 그림이 그려진다. 이 경우 add x14, x2, x2 부터는 맨 처음 sub에서 나온 x2 값을 이용할 수 있는데, and와 or의 경우에는 이용할 수 없다. 하지만 앞에서도 말했듯이 생각해보면 첫번째 계산의 결과가 5번째 단계에서 나오는게 아니라 세 번째 단계부터 avaliable하다는 것을 알 수 있다. 따..

Computer Engineering/Computer Architecture 2020. 12. 2. 17:55

RISC-V 컴퓨터구조 - 4. The Processor - 4.6. Pipelined Datapath and Control

Section 4.4 에서 살펴봤던 Single-cycle Datapath는 다음과 같다. 파란색으로 표시된 곳 빼고는 다 앞에서 뒤로 data가 전파된다. 두 개의 exception은 writeback stage와 Next PC value의 selection이다. 잘 생각해보면 이 두개가 data hazard와 control hazard의 요인이라고 볼 수 있다. 일단 한 번 pipeline의 예시를 보자. 이렇게 다섯 단계로 나뉜 pipeline의 중간에는 register가 있어 값을 저장할 수 있어야 한다. 만약에 register의 read와 write signal이 겹쳐도 해결할 방안이 있는데, clock cycle의 first half에는 written 할 수 있게 하고, second half에..

카테고리 없음 2020. 12. 2. 03:06

RISC-V 컴퓨터구조 - 4. The Processor - 4.5. An Overview of Pipelining

Pipelining 은 여러개의 instruction이 execute 하면서 overlap되는 것이다. 이를 빨래에 비유해보자. 빨래의 단계가 세탁, 건조, 정리의 세 단계라고 하면, Single-Cycle Implementation의 경우 첫 번째 빨래의 세탁, 건조, 정리가 끝나고 그 다음 빨래의 세탁, 건조, 정리를 하는 것이다. 하지만 Pipelining이 된 경우 첫 번째 빨래가 세탁이 끝나고 건조로 넘어가면 두 번째 빨래를 바로 세탁으로 넘긴다! 그렇게 순차적으로 기계를 쉬지 않고 돌리는 것이다. 이렇게 할 때 첫번째 빨래의 시작부터 끝까지의 시간은 줄어들지 않는다. 하지만 여러 개의 빨래를 동시에 진행함으로써 같은 시간 내에 많은 빨래를 할 수 있다. 따라서, pipelining은 singl..

Computer Engineering/Computer Architecture 2020. 12. 1. 16:57

경복궁 야간개장 (드디어 나도!!) - 2020/11/30(월)

어렸을 땐 경복궁을 자주 갔던 것 같은데, 서울에서 이사한 뒤로는 거의 가지 못했다. 매년 기회를 넘보고 있었는데 드디어!! 올해 경복궁 야간개장을 갈 수 있게 되었다. 날이 정말 추웠는데 남자친구가 다행히 장갑을 갖고와줘서 따뜻하게 구경할 수 있었다. (장갑과 핫팩은 필수..!) 저녁이라 사진이 잘 나올까 걱정했는데 핸드폰(갤럭시 S10) 카메라 기능에 내장되어 있는 Night mode를 사용하니 실제로 보는 것보다 더 예쁠 정도로 잘 나왔다. 날은 추웠지만 눈이 즐거웠던 밤이었다. 조선시대 왕족들은 달빛을 받으며 이런 밤길을 거닐었다니..! 다음 사진들은 다 경회루의 사진들인데, 경복궁에 있는 전 건물들 중에서 가장 아름다웠다. 호수에 비치는 경회루의 모습이 감탄을 자아냈다. 가장 인기있는 photo..

여행 2020. 12. 1. 13:55

RISC-V 컴퓨터구조 - 4. The Processor - 4.4. A simple Implementation Scheme

The ALU Control ALU에서는 4 가지 동작을 할 수 있는데, 바로 and, or, add, substract이다. 어떤 operation을 할지는 ALU에 전달되는 4bit짜리 신호가 결정하는데, 다음 표와 같다. 만약 load and store라면, ALU가 addition을 해서 memory address를 계산한다. R-type instruction이라면, ALU는 7-bit funct7 field(31:25) 와 3-bit func3 field(14:12)의 값에 따라 and, or, add, substract중 하나를 계산한다. Conditional branch의 경우에는 substract를 한다음에 0인지 아닌지 판단한다. 이를 구현하기 위해서 2bit짜리 control signa..

Computer Engineering/Computer Architecture 2020. 11. 30. 17:18

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